前邊似乎我們許多次提到了上拉電阻，下拉電阻，詳細究竟什么樣的電阻算是上下拉電阻，上下拉電阻都有何感化呢？
上拉電阻就是將不肯定的旌旗燈號經(jīng)過一個電阻拉到高電平，同時此電阻也起到一個限流感化，下拉就是下拉到低電平。
比方我們的 IO 設置為開漏輸入高電平或許是高阻態(tài)時，默許的電平就是不肯定的，內(nèi)部經(jīng)一個電阻接到 VCC，也就是上拉電阻，那么響應的引腳就是高電平；經(jīng)一個電阻到 GND，也就是下拉電阻，那么響應的引腳就是一個低電平。
上拉電阻使用許多，都可以起到什么感化呢？我們?nèi)缃翊我壤斫庾畛Ｓ玫囊韵?4 點：

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1. OC 門要輸入高電平，必需內(nèi)部加上拉電阻才干正常運用，其實 OC 門就相當于單片機 IO 的開漏輸入，其道理可參照圖 9-1 中的開漏電路。

2. 加大通俗 IO 口的驅(qū)動才能。規(guī)范 51 單片機的外部 IO 口的上拉電阻，普通多是在幾十 K 歐，比方 STC89C52 外部是 20K 的上拉電阻，所以大輸入電流是 250uA，因而內(nèi)部加個上拉電阻，可以構(gòu)成和外部上拉電阻的并聯(lián)合構(gòu)，增大高電平常電流的輸入才能。

3. 在電平轉(zhuǎn)換電路中，比方我們前邊講的 5V 轉(zhuǎn) 12V 的電路中，上拉電阻其實起到的是限流電阻的感化，可以回憶一下圖 3-8。

4. 單片機中未運用的引腳，比方總線引腳，引腳懸空時，輕易遭到電磁攪擾而處于雜亂形態(tài)，固然不會對程序形成什么影響，但平日會添加單片機的功耗，加上一個對 VCC 的上拉電阻或許一個對 GND 的下拉電阻后，可以無效的抵御電磁攪擾。

那么我們在停止電路設計的時分，又該若何選擇適宜的上下拉電阻的阻值呢？

1. 從下降功耗的方面思索該當足夠大，由于電阻越大，電流越小。

2. 從確保足夠的引腳驅(qū)動才能思索該當足夠小，電阻小了，電流才干大。

3. 在開漏輸入時，過大的上拉電阻會招致旌旗燈號上升沿變緩。我們來說明一下：實踐電平的變更多是需求工夫的，固然很小，但永遠都達不到零，而開漏輸入時上拉電阻的巨細就直接影響了這個上升進程所需求的工夫，如圖 9-2 所示。想一下，假如電阻很大，而旌旗燈號頻率又很快的話，最終將招致旌旗燈號還沒等上升到高電平就又變?yōu)榈土?，于是旌旗燈號就無法準確傳送了。

圖 9-2 上拉電阻阻值對波形的影響

綜合思索各類狀況，我們常用的上下拉電阻值大多拔取在 1K 到 10K 之間，詳細究竟多大平日要依據(jù)實踐需求來選，平日狀況下在規(guī)范規(guī)模內(nèi)就可以了，紛歧定是一個固定的值。

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文章題目：單片機上下拉電阻-創(chuàng)新互聯(lián)
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