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Makefile基本語法有哪些

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Makefile 基本語法

<target> : <prerequisites> 
[tab]  <commands>
  • target : 即自定義的想要執(zhí)行的命令

  • prerequisites: 前置條件,即執(zhí)行 target 命令之前執(zhí)行的命令

  • commands : 具體的執(zhí)行的命令

  • .PHONY 偽指令,內置的關鍵字

  • 不帶參數,默認執(zhí)行第一個 target

  • @ 表示禁止回聲,即終端不會打印真實的執(zhí)行命令

  • # 表示注釋

  • ${val} 表示變量,和 shell 腳本中的變量的聲明和使用一致

  • 允許使用 通配符

例如

APPNAME="hello".PHONY: buildbuild:clean    @go build -o ${APPNAME} main.go.PHONY: cleanclean:    @rm -rf ${APPNAME}

嵌套執(zhí)行

創(chuàng)建嵌套file文件

$ tree.├── Makefile├── hello│   ├── Makefile│   └── hello.go└── main.go1 directory, 4 files
$(MAKE) -C subdir

上面的命令等價于如下的命令

cd subdir && $(MAKE)

$(MAKE)就相當于make,-C 選項的作用是指將當前工作目錄轉移到你所指定的位置。

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網站標題:Makefile基本語法有哪些
標題來源:http://jinyejixie.com/article20/pggoco.html

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