無法拒絕Formal驗(yàn)證的4個(gè)理由分別是什么,相信很多沒有經(jīng)驗(yàn)的人對此束手無策,為此本文總結(jié)了問題出現(xiàn)的原因和解決方法,通過這篇文章希望你能解決這個(gè)問題。
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在討論Formal驗(yàn)證相比傳統(tǒng)動(dòng)態(tài)仿真驗(yàn)證的優(yōu)勢之前,讓我們先確認(rèn)一個(gè)共識:
動(dòng)態(tài)仿真、硬件加速或者其他的一些驗(yàn)證流程只能“證偽”,而不能“證明”。真正完備的驗(yàn)證應(yīng)該對設(shè)計(jì)進(jìn)行嚴(yán)謹(jǐn)?shù)財(cái)?shù)學(xué)分析,從原理上對進(jìn)行證明。
后者就是我們所說的形式驗(yàn)證(Formal Verification,F(xiàn)V)。(
Note0:這里的形式驗(yàn)證,主要指的是模型驗(yàn)證,而非大多數(shù)人所知的等價(jià)性驗(yàn)證。
Note1:Formal也有很多缺點(diǎn),所以現(xiàn)在Formal還不如動(dòng)態(tài)仿真驗(yàn)證普及。具體是哪些缺點(diǎn)需要各位自行體會了,F(xiàn)ormal和動(dòng)態(tài)仿真相結(jié)合才能發(fā)揮出驗(yàn)證人員最大的潛力。
Formal驗(yàn)證的優(yōu)勢包括:
1.解決真正的驗(yàn)證問題:對于面向?qū)嶋H工程問題的驗(yàn)證人員,驗(yàn)證方面的數(shù)學(xué)分析也許太過理論和不切合實(shí)際。但是如果你嘗試問下自己:我們究竟該如何驗(yàn)證或者說保證設(shè)計(jì)的正確性?大多數(shù)人還是會說,理想情況只能在數(shù)學(xué)上驗(yàn)證設(shè)計(jì)符合規(guī)格,而不是使用隨機(jī)激勵(lì)覆蓋那些人為提取的測試點(diǎn)。不幸的是,由于當(dāng)前EDA工具的缺憾,我們還是主要采納后者的驗(yàn)證方式。相信隨著工具的升級,我們會越來越多地采納形式驗(yàn)證對RTL,甚至更High level的設(shè)計(jì)進(jìn)行驗(yàn)證,以降低在后期驗(yàn)證發(fā)現(xiàn)BUG帶來的DEBUG成本。
2.完全覆蓋:覆蓋率(coverage)是指已經(jīng)驗(yàn)證通過的測試點(diǎn)占全部測試點(diǎn)的比例,本質(zhì)上FV會提供完全的覆蓋(如果你的功能覆蓋率文件沒有寫錯(cuò)的話)。這些需要覆蓋的測試點(diǎn)在動(dòng)態(tài)仿真上我們可能需要進(jìn)行等價(jià),只收集其中的一部分,并且要花費(fèi)數(shù)十倍于FV的時(shí)間成本。由于設(shè)計(jì)規(guī)模和工具算力的限制,對chip level進(jìn)行Formal驗(yàn)證幾乎是不可能的,但是在符合規(guī)格的輸入約束條件下,可以對某些關(guān)鍵模塊進(jìn)行block level的Formal驗(yàn)證,這相當(dāng)于對該模塊進(jìn)行“指數(shù)級”的動(dòng)態(tài)仿真,能夠提高驗(yàn)證的完備性和驗(yàn)證交付信心。
3.設(shè)計(jì)行為最小示例:大多數(shù)FV引擎都能夠生成設(shè)計(jì)行為的最小示例。如果Formal驗(yàn)證失敗,會展示出發(fā)生BUG的數(shù)個(gè)周期內(nèi)的設(shè)計(jì)行為,但是在典型的隨機(jī)動(dòng)態(tài)仿真環(huán)境中可能需要追溯到數(shù)千個(gè)周期前才能定位到問題所在(如果問題所在處沒有斷言),從而使得Formal驗(yàn)證的調(diào)試和問題定位非常容易。
4.邊界(Corner)場景:在FV的引擎中,工具會遍歷用戶尚未禁止的所有場景,這意味著形式驗(yàn)證能夠發(fā)現(xiàn)很多用戶都不會識別出來的邊界場景。而在動(dòng)態(tài)仿真中,驗(yàn)證工程師需要輸入有限的激勵(lì),這會導(dǎo)致這些邊界場景無法得到完備的驗(yàn)證,即發(fā)生漏測。究其根本,是因?yàn)閯?dòng)態(tài)仿真只指定有限的合理約束,而Formal驗(yàn)證只需要驗(yàn)證人員指定有限的錯(cuò)誤約束。相比前者,后者更容易做到。
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當(dāng)前名稱:無法拒絕Formal驗(yàn)證的4個(gè)理由分別是什么
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